基于DSP的视频采集系统设计.doc

1、基于 DSP 的视频采集系统设计类别： 单片机/DSP 阅读：9550 引言 数字图象处理技术在电子通信与信息处理领域得到了广泛的应用，设计一种功能灵活、使用方便、便于嵌入到系统中的视频信号采集电路具有重要的实用意义。在研究基于 DSP 的视频监控系统时，考虑到高速实时处理及实用化两方面的具体要求，需要开发一种具有高速、高集成度等特点的视频图象信号采集系统，为此系统采用专用视频解码芯片和复杂可编程逻辑器件(CPLD)构成前端图象采集部分。设计上采用专用视频解码芯片，以 CPLD 器件作为控制单元和外围接口，以 FIFO 为缓存结构，能够有效地实现视频信号的采集与读取的高速并行，具有整体电路简单

2、、可靠性高、集成度高、接口方便等优点，无需更改硬件电路，就可以应用于各种视频信号处理系统中。使得原来非常复杂的电路设计得到了极大的简化，并且使原来纯硬件的设计，变成软件和硬件的混合设计，使整个系统的设计增加柔韧性。 1 系统硬件平台结构系统平台硬件结构如图 1 所示。整个系统分为两部分，分别是图象采集系统和基于 DSP 主系统。前者是一个基于 SAA7110A/SAA7110 视频解码芯片，由复杂可编程逻辑芯片 CPLD 实现精确采样的高速视频采集系统；后者是通用数字信号处理系统，它主要包括：64K WORD 程序存储器、64K WORD 数据存储器、DSP、时钟产生电路、串行接口及相应的电平

3、转换电路等。系统的工作流程是，首先由图象采集系统按 QCIF 格式精确采集指定区域的视频图象数据，暂存于帧存储器 FIFO 中；由DSP 将暂存于 FIFO 中的数据读入 DSP 的数据存储器中，与原先的几帧图象数据一起进行基于 H.263 的视频数据压缩；然后由 DSP 将压缩后的视频数据平滑地从串行接口输出，由普通 MODEM 或 ADSL MODEM 传送到远端的监控中心，监控中心的 PC 机收到数据后进行相应的解码，并将还原后的视频图象进行显示或进行基于 WEB 的广播。2 视频信号采集系统2.1 视频信号采集系统的基本特性一般的视频信号采集系统一般由视频信号经箝位放大、同步信号分离、

4、亮度/色度信号分离和 A/D 变换等部分组成，采样数据按照一定的时序和总线要求，输出到数据总线上，从而完成视频信号的解码，图中的存储器作为帧采样缓冲存储器，可以适应不同总线、输出格式和时序要求的总线接口。视频信号采集系统是高速数据采集系统的一个特例。过去的视频信号采集系统采用小规模数字和模拟器件，来实现高速运算放大、同步信号分离、亮度/色度信号分离、高速 A/D 变换、锁相环、时序逻辑控制等电路的功能。但由于系统的采样频率和工作时钟高达数十兆赫兹，且器件集成度低，布线复杂，级间和器件间耦合干扰大，因此开发和调试都十分困难；另一方面，为达到精确采样的目的，采样时钟需要和输人的视频信号构成同步关系

5、，因而，利用分离出来的同步信号和系统采样时钟进行锁相，产生精确同步的采样时钟，成为设计和调试过程中的另一个难点。同时，通过实现亮度、色度、对比度、视频前级放大增益的可编程控制，达到视频信号采集的智能化，又是以往系统难以完成的。关于这一点，在系统初期开发过程中已有深切体会1。基于以上考虑，本系统采用了 SAA7110A 作为视频监控系统的输入前端视频采样处理器。2.2 视频图象采集系统设计SAA7110/SAA7110A 是高集成度、功能完善的大规模视频解码集成电路2。它采用 PLCC68 封装，内部集成了视频信号采样所需的 2 个 8bit 模/数转换器，时钟产生电路和亮度、对比度、饱和度控制

6、等外围电路，用它来替代原来的分立电路，极大地减小系统设计的工作量，并通过内置的大量功能电路和控制寄存器来实现功能的灵活配置。SAA7110/SAA7110A 可应用的范围包括桌面视频、多媒体、数字电视机、图象处理、可视电话、视频图象采集系统等领域。SAA7110/SAA7110A 的控制总线接口为 I2C 总线。SAA7110/SAA7110A 作为 I2C 总线的从器件，根据 SA 管脚的电平，器件的读写地址可以分别设置为 9CH/9DH(W/R，SA=0)或 9DH9FH(W/R，SA=1)。其内部共计 47 个寄存器，分别控制解码器(00H19H) 和视频接口(20H34H) 。通过 I

7、2C 总线读、写片内的上述寄存器，可以完成输入通道选择、电平箝位和增益控制、亮度、色度和饱和度控制等功能。但是，有一个问题必须解决，那就是 DSP 芯片没有内置 I2C 总线接口，为此，本系统提出并采用了对 DSP 芯片的两个可编程 I/O 引脚进行软件仿真来实现 I2C 总线控制的方法。由于受 C2000 程序存储空间最大仅有 64KB 的限制，为了减小 I2C 总线控制仿真软件的规模，仿真软件全部用汇编语言完成，因而给本系统的设计带来了相当的难度和工作量。 3 系统实验与仿真在实时系统的设计中，同步与精确采样是两个至关重要的问题，它们直接关系到系统设计的成败。由于 SAA7110A 输出的

8、两个时钟信号 LCC 和 LCC2 与采样时钟和数据输出时钟同步，因而可以作为采样数据接口控制子系统中数据存储控制的时钟和完成各种功能的同步时钟，系统不需要再生成或采用另外的时钟信号，从而避免了外部时钟、采样时钟和视频信号相互间的同步和锁相问题，既保证了整个系统的同步，又极大地降低了系统设计的复杂度。由 SAA7110A 输出的行有效信号 HREF、行同步信号 HS、场同步信号 VS、奇偶场信号 ODD，以及系统采样时钟 LCC 和二分之一分频时钟 LCC2 等经过处理，可以获得当前采样位置信息，并与产生帧存储器地址、片选和写控制信号一起实现采样的时间、空间位置和精度的要求。根据 DSP 芯片

9、的读时序( 如图 2 所示)、写时序、 SAA7110A 芯片 HREF 信号时序、Vertical 信号时序(如图 3 所示)和 Horizontal 信号时序的要求，按照采集 QCIF(176144)格式图象的需要，设计了 CPLD 精确采样的时序逻辑(如图 4 所示)。(b)图 4 CPLD 时序仿真图 (a) CPLD 精确采样的时序逻辑；(b) 对上图(b) 进行 32 倍放大从图 4 得到的 CPLD 后时序仿真结果来看，完全达到了预定的精确采样要求。真正地实现了具有正确比例关系的精确采样，效果良好。 4 结论在基于 DSP 的视频图象采集系统设计中，采用视频专用解码 A/D 芯片和复杂可编程逻辑器件 CPLD 进行控制和接口部分设计能够有效地实现视频信号的采集与读取的高速并行，具有整体电路简单、可靠性高、集成度高、接口方便等优点，无需更改硬件电路，就可以应用于各种视频信号处理系统中。使得原来非常复杂的电路设计得到了简化，使整个系统的设计增加柔韧性。 参考文献1 孙继平，关永. DSP 极低码率的矿井远程视频监控系统J. 西安科技学院学报，2003，23(3):283-2862 Philips Semiconductors. SAA7110/SAA7110A Data SheetEB/OL, 2001