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精选优质文档-倾情为你奉上 HDL综合实验报告学号：电气班一.实验目的通过使用ISE13.4和FPGA进行简单逻辑门的设计与实现，进而达到以下目的：1)学习使用ISE软件生成一个新工程文件；2)学习使用HDL进行电路设计；3)学会编辑顶层文件和用户约束文件；4)熟悉仿真、综合、实现以及FPGA配置等；5)熟悉在Basys2开发板上的简单外围设备的控制。二.实验要求数字钟设计一个完整的数字钟，小时和分钟用数码管显示，秒用发光二极管闪烁显示，每秒闪烁。如有可能，请增加校时功能（P162，（2）。三.实验内容1).工程文件的建立操作步骤： File-New Project-输入工程文件名-选择Family:Spartan 3E;De