精选优质文档-倾情为你奉上武汉大学集成电路设计实验实验报告 电子信息 学院 电子信息工程 专业 2014 年 5 月 2 日实验名称逻辑综合(DC工具)实验指导教师姓名江燕婷年级2011级学号25成绩一、预习部分1 实验目的(预期成果)2 实验基本原理(概要)3 主要仪器设备(实验条件,含必要的元器件、工具)一、实验目的1.掌握综合的基本流程和Design Compile软件的使用2.对设计进行分块设计以获得更好的综合效果;3. 对设计进行时间约束的综合。二、实验原理1.综合DC是把RTL级的代码转化为门级网表。综合包括翻译,优化,映射三个步骤。优化是基于所施加的一定时序和面积的约束条件,综合器按照一定的算法对翻译结果做逻辑优化和重组。在映射过程中,根据所施加的一定的时序和面积的约束条件,综合器从目标工艺库总搜索符合条件的单元来构成实际电路。2.时序与面积约束 通过描述其设计环境,目标任务和设计规则来系统的约束
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