基于D触发器的异步八进制加法计数器的设计(共7页).doc

上传人:晟*** 文档编号:11363806 上传时间:2022-02-20 格式:DOC 页数:7 大小:179KB
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精选优质文档-倾情为你奉上基于SIMULINK的异步八进制加法计数器的设计1 设计题目的理论分析1.1 设计题目用D触发器设计异步八进制的加法计数器。并作出相应的时序图。使用Simulink进行简单的仿真。1.2 理论分析这个题目是要求设计一个八进制加计数器,即三位二进制加计数器,并且用D触发器最终完成电路。解题具体过程如下:(1) 明确所需要设计的电路的功能并画出状态图 本题要求我们用D触发器设计一个八进制加计数器,所以根据其特点,可判断电路需要三个D触发器来实现,故可作出其状态图如下:CP为时钟信号,C为进位信号。(2) 列出激励表在列激励表时,对于某一输出,当其状态不发生反转时,此时可取其时钟信号为0,这样其输入端的的取值就不会对输出产生影响,这样一来,就可以达到简化电路的目的。表1 八进制异步加计数器激励表000X0X011001001X0110101001

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