4位加减法并行运算电路(包括拓展8位).docx

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资源描述

二O二二O三学年第一学期电子信息工程系脉冲数字电路课程设计报告书班级:电子信息工程(DB)1004班课程名称:脉冲数字电路课程设计学时:r周学生姓名:学号:指导教师:二O二年九月、设计任务及主要技术指标和要求设计目的1. 掌握加/减法运算电路的设计和调试方法。2. 学习数据存储单元的设计方法。3. 熟悉集成电路的使用方法。设计的内容及主要技术指标1设计4位并行加/减法运算电路。2设计寄存器单元。3设计全加器工作单元。4设计互补器工作单元。5扩展为8位并行加/减法运算电路(选作)。设计的要求1根据任务,设计整机的逻辑电路,画出详细框图和总原理图。2选用中小规模集成器件(如74LS系列),实现所选定的电路。提出器材清单。3检查设计结果,进行必要的仿真模拟。方案的总体设计步骤一因为参与运算的两个二进制数是由同一条数据总线分时串行传入,而加法运算的时候需要两个数的并行输入。所以需要两个寄存器分别通过片选信号,依次对两个二进制进行存储,分别在寄存器的QAQB

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