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EDA实验实验报告学 号： 姓 名： 彭文勇 院 系： 微电子技术系 专 业： 嵌入式 教 师： 李 海 2010年12月实验一 一位全加器的设计实验地点：第二实验楼405 同组人员：孙腾坤 一、 实验目的通过次实验我们逐步了解、熟悉和掌握FPGA开发软件Quartus II的使用及Verilog HDL的编程方法。学习用Verilog HDL语言以不同的方式来描述1位全加器及电路的设计仿真和硬件测试。二、实验原理和内容本实验的内容是建立一个1位全加器。具体内容包括：（1） 使用Quartus II建立工程、编写程序；（2） 进行波形仿真验证；（3） 进行硬件测试。通过SmartSOPC试验箱上的按键KEY1KEY3输入信号，分别为A、B和cin,并通过LED1指示相应的状态。输出和通过LED7和LED8指示（灯亮表示输入或