IBM在ASIC设计中的电源网络噪声分析推荐给好友打印加入收藏文章出处：与非网 更新于2009-10-09 11:40:45IBM ASIC Power Noise 网络噪声 噪声分析 电源网络 1前言IBM在芯片设计方面有着独特并且有效的方式，在其开展的ASIC业务中，不仅提供客户高可靠性的定制化设计方案，而且拥有科学的分析能力，即便现代的芯片开发周期不断缩减，我们还是保持着严谨的作风，提供给每一个客户高质量的产品。本文将侧重于高速信号传输领域，介绍IBM对于PowerNoise分析的一些基本思路。众所周知，目前的窜行通讯接口一般都工作在10GBps上下，对于发送/接受，时钟频率控制单元有着极其严苛的电气要求,随之而来的就是更近一步的对芯片资源规划(FloorPlan)的要求。这些由电气要求转化而来的物理约束，因各种器件而不同，往往在空间资源比较紧张的项目中互相抵触，令普通开发者进退两难。对客户不利的是，往往会有很多供应商仓促上阵，最终导致产品瑕疵，或者反复设计，验证，延误了宝贵的上市时机。IBM的确在这方面也遇到了
