基于VHDL语言的数字秒表的实现.doc

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资源描述

1 设计方案1. 1 􀀂 系统功能要求( 1) 具有时钟秒表系统功能要求显示功能, 用6个数码管分别显示时、分、秒; 计时范围为:00: 00: 00 23: 59:59。( 2) 计时精度是1s;( 3) 具有启/ 停开关, 复位开关, 可以在任何情况下使用。1. 2 􀀂 总体框图根据系统设计要求, 系统的底层设计主要由六十进制计数器模块、二十四进制计数器模块、分频模块、LED显示模块组成。系统顶层设计图如图所示:图中左边为三个输入信号en,clk,reset;分为启/ 停开关,时钟信号和复位开关。中间是从上倒下时count24,count60,count60,fenpinqi;右边是clock1和输出信号wei3.0, led6.0。2 􀀂 模块功能设计由六十进制计数器模块、二十四进制计数器模块、分频模块执行计时功能, 输入信号是256 Hz,通过分频后为1hz,时钟信号是1 Hz 作为秒表的秒输入, 秒为60 进制计数器, 分也为60 进制计数器, 小时采用二十四进制计数器, 各级进位作为高位的使能控制

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