关于ALTERA提供的FIFO核使用原理.doc

上传人:小陈 文档编号:5291051 上传时间:2021-02-14 格式:DOC 页数:6 大小:79.50KB
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.关于ALTERA提供的FIFO核使用原理2008-08-16 23:35ALTERA提供了LPM_FIFO参数宏模块,可以在代码中例化使用。FIFO有两种工作模式:(1)SCFIFO,(2)DCFIFO其中SCFIFO指读写用一个时钟进行同步,可以支持同时读写的功能。其中DCFIFO指读写使用不同的时钟进行同步,这在设计多时钟系统中相当有用,可用于不同时钟同步信号之间的同步调整。首先看看DCFIFO模式下的几个比较重要的信号:A在写端,主要有以下几个信号: (1) datan-1:0:写入数据信号总线; (2) wrreq:写入请求信号,高有效 (2) wrclk:写入同步时钟; (3) wrfull, wrempty:用于指示写端FIFO为空或者满的状态; (4) wrusedwlog2(SIZE_FIFO)-1:0 :写入的数据个数,按写入个数递增;上述信号都与写入时钟srclk同步;B在读端,主要有以下几个信号: (1) qn

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