eda实验7段数码显示译码器(共11页).doc

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精选优质文档-倾情为你奉上7段数码显示译码器设计宁夏大学 物理电气信息学院 2010级通信工程专业 马福蕊 2012/12/16【摘要】7段数码管是纯组合电路,通常的小规模专用IC,如74或4000系列的器件只能做十进制BCD译码,然而数字系统中的处理和运算都是二进制,所以输出表达都是十六进制的,为了满足十六进制数的译码显示,最方便的方法就是利用译码程序在FPGA/CPLD中来实现。本实验中的7段译码管输出信号LED7S的7位分别接数码管的7个段,高位在左,低位在右。【关键字】七段显示译码器;VHDL语言;Quartus软件一、相关介绍1、VHAL语言的简介VHDL 的英文全名是 Very-High-Speed Integrated Circuit Hardware Description Language,诞生于 1982 年。1987 年底,VHDL被 IEEE 和美国国防部确认为标准硬件描述语言。 VHDL主要用于描述数字系统的结构,行为,功能和接口。除了含有许多具有硬件特征的语句外,VHDL的语言形式和描述风格与句法是十分

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