verilog八位十进制计数器实验报告(附源代码)(共10页).docx

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资源描述

精选优质文档-倾情为你奉上8位10进制计数器实验报告一、 实验目的l 学习时序逻辑电路l 学会用verilog语言设计时序逻辑电路l 掌握计数器的电路结构l 掌握数码管动态扫描显示原理二、 实验内容实现一个8bit十进制(BCD码)计数器端口设置:用拨动开关实现复位和使能LED灯来表示8位数据用数码管显示16进制的八位数据1. 复位时计数值为8h02. 复位后,计数器实现累加操作,步长为1,逢9进1,,计数值达到8h99后,从0开始继续计数3. 使能信号为1时正常计数,为0时暂停计数,为1时可继续计数。4. 每0.5s计数值加15. 8位的结果显示在LED灯上,其中LED灯亮表示对应的位为1,LED灯灭表示对应的灯为06. 用isim进行仿真,用forever语句模拟时钟信号输入,并给变量赋值仿真initial语句。7. 用7段数码管的后两位显示16进制下8位结果。三、 实验结果烧写结果:拨动reset开关到1时,LED灯显示,7段数码管显示“90”。之后拨动W

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