精选优质文档-倾情为你奉上1,使用原理图文件设计三分频电路:仿真需要设置function功能,然后生成网表(processing)仿真结果:2,使用Verilog 程序设计三分频,四分频,五分频设计三分频:module sanfp(clkin,clkout);input clkin;output clkout;reg1:0 step1,step;always (posedge clkin)begincase (step)2b00:step=2b01;2b01:step=2b10;2b10:step=2b00;default:step=2b00;endcaseendalways (negedge clkin)begincase(step1)2b00:step1=2b01;2b01:step1=2b10;2b10:step1=2b00;de
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