用数据选择器设计组合逻辑电路.doc

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资源描述

1、用数据选择器设计组合逻辑电路一、用一片四选一数据选择器实现逻辑函数: BCAY/要求写出分析与计算过程并画出连线图。四选一数据选择器的功能表及逻辑图如下图所示。 (10 分)解一:(1)选 A、B 作为数据选择器的地址码 A1、A 0,将逻辑函数变形为:)()()1()(/ / CBCY(2)将变形后的逻辑函数与四选一数据选择器的输出逻辑式进行比较得: 013/0120/1/01 ADADY3/2/0;(3)连接电路:解二: (1) 、写出四选一数据选择器的逻辑表达式:(2 分)SADADY )( 013/0120/1/01(2) 、把所求逻辑函数的表达式变形:(4 分)CABBAC)()(1

2、)()( / / (3) 、确定电路连接:(4 分)将上述两个表达式进行比较,可知应令:,即1S0/;ABCDCD3/21/0;(4) 、画出连接图:( 2 分)二、试用一片四选一数据选择器实现逻辑函数: CBABCAY要求写出详细的设计过程并画出连线图。四选一数据选择器的功能表及逻辑图如图(a) 、(b)所示。 (10 分)解: (1) 、把所求逻辑函数的表达式变形:(4 分)(2) 、与四选一数据选择器的逻辑表达式进行比较,确定电路连接:(4 分)(3) 、画出连接图:( 2 分)解: (1) 、把所求逻辑函数的表达式变形:(4 分)CABCBAY)()()()( (2) 、确定电路连接:

3、(4 分)四选一数据选择器的逻辑表达式为: SDDY )( 013/0120/1/01两个表达式进行比较,可知应令:; ; S01;ABCC3210;(3) 、画出连接图:( 2 分)三、试用双 4 选 1 数据选择器 CC14539 实现组合逻辑函数:BCACBAZ12已知 CC14539 的逻辑功能表达式和方框图如下: 13012010101 )( SDADAY 2222四、用一片四选一数据选择器设计一个 3 变量的多数表决电路。要求写出分析与计算过程并画出连线图。四选一数据选择器的功能表及逻辑图如下图所示。(15 分)解:(1)列写真值表:设参加表决的三个人分别用 A、B 和 C 来表示

4、,表决结果用 Y 表示;个人同意与表决通过均用 1 表示,个人不同意与表决没通过均用 0 表示。(2)列写表达式: ABCABCY/(3)选用 B、C 作为四选一数据选择器的地址码 A1、A 0,将逻辑函数变形为:)1()()()0( / (4)将变形后的逻辑函数与四选一数据选择器的输出逻辑式进行比较得: 013/0120/1/01 ADADY;320 (5)电路连线图;五、试用 8 选 1 数据选择器 74HC151 产生逻辑函数 。BACABY/已知 74HC151 在控制端 的情况下,输出的逻辑表达式为:)1(0/S/ 0127/01260/125/0124 /3YWADADA解:(1)

5、选 A、B、C 作为数据选择器的地址码 A2、A 1、A 0,将逻辑函数变形为:ABCABY)0()1()0()( / / (2)将变形后的逻辑函数与四选一数据选择器的输出逻辑式进行比较得: 0127/01260/125/0124 /3DDY;63740 (3)连接电路:B:试用八选一数据选择器 74LS151 实现如下逻辑函数:。BACABY/74LS151 的管脚排列图如下。 (图中 16 脚 VCC 是电源正端;8 脚 GND 是电源地端;4、3、2、1、15、14、13、12 脚 D0D7 八个数据输入端;9、10、11 脚C、B、A 是三个地址输入端;5 脚 Y 是原码数据输出端;6

6、 脚 W 是反码数据输出端;7 脚 是附加控制端,低电平有效。/G解:(1)选 A、B、C 作为数据选择器的地址码 C、B、A,将逻辑函数变形为:ABABY)0()1()0()( 1/ / (2)将变形后的逻辑函数与八选一数据选择器的输出逻辑式进行比较得: 1;63275410 DD(3)连接电路:六、用 8 选 1 数据选择器 74HC151 设计一个组合逻辑电路。该电路有 3 个输入逻辑变量 A、B、C 和 1 个工作状态控制变量 M。当 M=0 时电路实现“意见一致”功能(A、B、C 状态一致时输出为 1,否则输出为 0) ,而 M=1 时电路实现“多数表决”功能,即输出与 A、B、C 中多数的状态一致。(15 分)已知 74HC151 在控制端 的情况下,输出的逻辑表达式为:)(0/S/ 0127/01260/125/0124 /3YWADDA解:1、 (15 分)(1)列写真值表(3 分)(2)列写表达式(3 分) )()( / ABCABCMABCMY

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